Insper RISC-V

Documentação do Projeto

CTI Renato Archer e Insper Capstone

RISC-V

RISC-V

Visual Studio Code e Docker

Editor de texto customizável e ambiente de desenvolvimento conteinerizado pré-configurado.

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Intel® Quartus® Prime Lite

Plataforma de desenvolvimento para placas FPGA Intel inclusa programável por servidor JTAG.

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TerosIDE e OSS CAD Suite

Distribuição de software binário para síntese RTL, verificação formal de hardware, programação FPGA, testes e mais.

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Cocotb e Pytest

Framework de testes unitários e de integração para linguagens HDL com visualização de síntese e simulação

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Organização

CTI Renato Archer

Realização @ MCTI

Saulo Finco

Mentor @ MCTI

Rafael Corsi

Orientador @ Insper

Equipe Capstone 2025.1

Caio Travain

Desenvolvedor @ Insper

Pedro Portella

Desenvolvedor @ Insper

Pedro do Amaral

Desenvolvedor @ Insper

Pedro Paulo Camargo

Desenvolvedor @ Insper

Eddie Villegas

Contribuidor @ ECEN TAMU

Jadon Dewey

Contribuidor @ ECEN TAMU

Equipe Capstone 2024.2

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Arthur Barreto

Desenvolvedor @ Insper

Eduardo Barros

Desenvolvedor @ Insper

Rodrigo Patelli

Desenvolvedor @ Insper

Vitor Assis

Desenvolvedor @ Insper

Eddie Villegas

Contribuidor @ ECEN TAMU

Jadon Dewey

Contribuidor @ ECEN TAMU

Equipe Capstone 2024.1

Leia o relatório → Matéria oficial ⧉

Giancarlo Ruggiero

Desenvolvedor @ Insper

Luciano Felix

Desenvolvedor @ Insper

Tiago Seixas

Desenvolvedor @ Insper