WB - Escreve o Retorno

Topologia

Interface genérica

GENERATE_REGISTERS GENERIC

Define geração de registradores de pipeline.

• Tipo: boolean
• Padrão: TRUE

Interface de portas

clock INPUT

Entrada do sinal de clock.

• Tipo: std_logic

clear INPUT

Entrada do sinal que limpa o(s) dado(s) do componente.

• Tipo: std_logic

enable INPUT

Entrada do sinal que ativa o componente.

• Tipo: std_logic

source INPUT

Entrada de registro que contém os dados vindos da etapa MEM do pipeline.

• Tipo: t_SIGNALS_MEM_WB

enable_destination OUTPUT

Saída de sinal que ativa escrita no banco de registradores.

• Tipo: std_logic

select_destination OUTPUT

Saída do endereço do registrador de destino.

• Tipo: t_REGISTER

destination OUTPUT

Saída do valor a ser armazenado no registrador de destino.

• Tipo: t_DATA

Usagem

WRITE_BACK : entity WORK.CPU_STAGE_WB(RV32I)
    port map (
        clock              => clock,
        clear              => clear,
        enable             => enable,
        enable_destination => stage_wb_enable_destination,
        select_destination => stage_wb_select_destination,
        source             => signals_mem_wb,
        destination        => stage_wb_data_destination
    );

Diagrama RTL

zoom: alt+scroll

Casos de teste

TO DO

### Caso 1 <Badge type="info" text="tb_stage_wb_case_1" />

Forma de onda:

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![Forma de onda do caso de teste 1 do Escreve o Retorno](/images/reference/entities/tb_stage_wb_case_1.svg){.w-full .dark-invert}

</pan-container>