Multiplexador 4x1

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Atribui saída conforme entrada selecionada dentre quatro

Topologia

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Genericos

Nome	Tipo	Valor	Descrição
DATA_WIDTH	natural	8	Largura dos vetores de dados

Portas

Nome	Direção	Tipo	Descrição
selector	input	std_logic_vector<2>	Seletor dos vetores de dados
source_1	input	std_logic_vector<DATA_WIDTH>	Vetor de dados 1
source_2	input	std_logic_vector<DATA_WIDTH>	Vetor de dados 2
source_3	input	std_logic_vector<DATA_WIDTH>	Vetor de dados 3
source_4	input	std_logic_vector<DATA_WIDTH>	Vetor de dados 4
destination	output	std_logic_vector<DATA_WIDTH>	Vetor de dados selecionado

Usagem

MUX_1 : entity WORK.GENERIC_MUX_4X1
    generic map (
        DATA_WIDTH_0 => 8
    )
    port map (
        source_1    => signal_source_1,
        source_2    => signal_source_2,
        source_3    => signal_source_3,
        source_4    => signal_source_4,
        selector    => signal_selector,
        destination => signal_destination
    );

Diagrama RTL

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Casos de teste

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tb_GENERIC_MUX_4X1_case_1

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